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高通
3DIC Yield Engineer, Sr. Staff
立即应聘

3DIC Yield Engineer, Sr. Staff

发布于 大约 12 小时前

普通员工/个人贡献者

Hsinchu City, Hsinchu City, Taiwan
高级经验
全职员工
仅现场办公
本科
TSV
DRAM
ATPG
3DIC
ML/AI
Diagnostics
Bist/Bira
Interposer
Memory Bitmap
Scan Diagnosis

AI 估算 · 25k–40k

资深半导体良率工程师,高通台湾,市场薪资水平较高,技能稀缺,月薪人民币2.5-4万。

职位详情

关于这个职位

该职位是高通ASICS工程部门的3DIC良率工程师,负责先进2.5D/3D封装产品的数据驱动良率提升

您将分析海量测试数据(内存位图、扫描诊断、TSV/中介层测试等),识别故障模式并定位根因,推动良率改进
需要具备半导体诊断分析经验,熟悉Python及统计/机器学习方法

最低要求

科学、工程或相关领域的学士学位,以及6年以上ASIC设计、验证、确认、集成或相关工作经验

或
科学、工程或相关领域的硕士学位,以及5年以上ASIC设计、验证、确认、集成或相关工作经验
或
科学、工程或相关领域的博士学位,以及4年以上ASIC设计、验证、确认、集成或相关工作经验

工作职责

诊断数据分析**

分析来自晶圆分类、最终测试和模块/堆叠测试的大规模故障数据,识别系统性和参数性故障趋势
解释跨SRAM、嵌入式DRAM和堆叠DRAM的内存位图诊断数据
对故障模式进行分类并与已知缺陷特征关联
评估TSV/中介层故障、连续性测试结果和3D堆叠测试模式,以检测跨层的系统性问题
分析扫描和ATPG诊断输出,对疑似根因进行聚类,并支持缺陷机制缩小
良率学习与关联**
将诊断结果与布局、工艺、晶圆厂元数据、封装步骤和环境应力因素关联
识别高影响故障机制,量化其对良率、DPPM和可靠性的影响
构建结构化工作流,跨多个批次或产品系列关联内存修复数据、冗余使用模式和缺陷密度
提供清晰摘要,加速硅片、组装和测试团队的根因识别
工作流、工具和自动化**
开发并维护脚本、仪表板或工具,自动化诊断结果分析
与内部软件团队紧密合作,改进内存位图、扫描诊断和3DIC测试日志的数据管道
在适用处使用统计技术和选择性AI/ML方法增强信号提取、聚类或异常检测
确保分析工作流在产品爬坡和大数据量下可扩展
跨职能协作**
与测试工程、DFT、工艺技术、封装和FA团队合作,解释诊断数据并验证假设
交付清晰的可视化和报告,指导良率改进决策
参与系统性故障机制的跨职能深度分析,并提出数据支持的下一步措施

优先资格

电气工程、计算机工程、数据科学或相关领域的硕士或博士学位

在良率分析方面有丰富经验,包括先进的2.5D、3DIC和DRAM产品
对半导体测试结果分析、硅调试或内存诊断和扫描诊断有深入理解
熟练掌握Python或等效语言进行数据分析和自动化
能够解释复杂的测试数据集并提取有意义的诊断信号
较强的英语沟通能力,能够清晰呈现技术结论

AI 洞察

优缺点分析

优点

  • 高通是全球领先的半导体公司,平台大,技术前沿,能接触最先进的3DIC工艺
  • 职位聚焦数据驱动良率提升,技能稀缺,市场价值高,职业发展前景好
  • 团队协作氛围浓厚,有机会与顶尖工程师共事,快速积累经验
  • 工作地点台湾新竹,需现场办公5天,对工作生活平衡有一定影响
  • 职位要求多年经验,技术深度高,学习曲线陡峭,需要持续学习新技术

缺点 / 挑战

  • 良率压力大,需在竞争激烈的半导体行业快速解决问题
  • 适合有多年半导体良率或测试经验、热爱数据分析、愿意深耕先进封装技术并对挑战有热情的工程师

角色解读

  • 在良率工程领域深耕,成为专家级技术主管或架构师
  • 向管理方向发展,领导良率分析团队或跨部门项目
  • 拓展至芯片设计、DFT或测试工程等相邻领域,提升系统级视野
  • 分析3DIC测试数据(内存位图、扫描诊断、TSV测试等),识别故障模式和系统性问题
  • 与跨职能团队(测试、DFT、工艺、封装)协作,定位良率根因并推动改进
  • 开发自动化脚本和仪表板,提升诊断数据分析效率和可扩展性
  • 扎实的半导体测试和良率分析经验,尤其是2.5D/3DIC和DRAM产品
  • 精通Python等编程语言,用于数据分析和自动化脚本开发
  • 熟悉内存位图分析、扫描诊断、ATPG和BIST/BIRA数据解读
  • 具备统计分析和机器学习基础,能应用于故障聚类和异常检测

申请策略

  • 了解高通在3DIC领域的布局(如Snapdragon芯片的先进封装),在面试中展示您的行业认知
  • 准备好一个您主导的复杂故障分析案例,用数据驱动的方式呈现解决思路
  • 突出您在过去项目中处理3DIC/2.5D良率分析的成果,包括具体的故障模式定位和良率提升数据
  • 强调Python编程能力,尤其是数据分析和自动化脚本的实际应用案例
  • 展示您对内存诊断、扫描诊断或DFT的理解,以及跨团队协作的经验
  • 如果缺乏3DIC经验,可以学习TSV、中介层测试和堆叠测试的基本原理
  • 提升机器学习技能,尤其是聚类、异常检测在半导体数据中的应用
  • 熟悉高通常用的内部工具或开源数据可视化库(如Plotly、Dash)会加分

面试指南

  • STAR方法:描述情境、任务、行动和结果,突出数据驱动的决策过程
  • 结构化思考:先定义问题,然后从数据清洗、特征提取、模式识别到根因验证的逻辑链条
  • 强调量化成果:用具体数字(如良率提升X%,DPPM降低Y%)展示影响力
  • 请描述一次您通过分析诊断数据定位3DIC良率根因的经历
  • 如何处理大量不一致的测试数据?如何区分系统性故障和随机故障?
  • 解释一下内存位图分析中的常见故障模式(如行/列故障、猝发故障等)及如何分类?
  • 您如何设计一个自动化仪表板来监控多个产品的良率趋势?
  • 在高通,您如何平衡自动化开发和手动深度分析的时间?

匹配度报告

68
综合匹配度

高通台湾3DIC良率工程师,前沿技术栈,薪资较高,但要求5天现场办公,WLB一般。

适合人群
该职位最适合重视技术成长和薪资回报、能接受高强度现场办公的资深工程师。
最强匹配
成长发展匹配
最弱匹配
工作生活匹配
薪资福利80
成长发展85
工作生活40
使命价值65

薪资福利匹配

80较高

薪资水平在台湾半导体行业具有竞争力,高通提供完善的福利(如健康保险、员工配股等),但未提及具体薪资,属于面议。

薪资信号面议 (25K-40K/月)

成长发展匹配

85较高

工作涉及前沿3DIC技术和AI/ML应用,技能提升空间大;但JD未明确提及晋升通道或培训。

技术前沿前沿/新兴技术
技术栈3DIC、Yield Analytics、ML/AI、DRAM、Python
业务类型ambiguous

工作生活匹配

40较低

明确要求5天现场办公,无远程或弹性工作安排,工作地点在新竹科技园区,通勤便利性一般。

工作模式仅现场办公
办公地点科技园/产业园
加班情况未提及(无法判断)

使命价值匹配

65中等

半导体行业属于成熟稳定赛道,但3DIC是前沿领域,对社会技术发展有推动作用;职位未明确提及使命感。

行业发展稳定成熟行业
社会影响中性/一般
创新程度积极采用新技术
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