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职位搜索/小米/顶尖应届-关键底层电路优化工程师-芯片
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小米 (Xiaomi)

职位信息

上海市
中级经验
全职员工
仅现场办公
学历未注明
普通员工/个人贡献者

标签

SystemVerilog低功耗设计PPA优化SoC设计EDA工具VCSPTPXArm/Risc-VDc
💡

核心评价

技术壁垒高、发展前景广阔的芯片核心设计岗,薪资竞争力强,但需对工作强度有心理准备。

顶尖应届-关键底层电路优化工程师-芯片

🤖 AI 估测:¥25K-40K

发布时间:大约 1 个月前

立即应聘

ℹ️关于这个职位

这是一个面向顶尖应届生的芯片底层电路优化工程师职位,专注于SoC(系统级芯片)的低功耗设计与性能优化
你将参与从系统策略制定到具体技术方案(如功耗控制、时钟复位、启动流程)的设计与开发,并有机会结合大模型负载分析等前沿课题,在端侧设备的严苛限制下探索自动化优化方法,目标是实现芯片在功耗、性能和面积(PPA)上的综合最优

✓工作职责

参与SoC低功耗整体策略制定与系统设计方案分析
负责低功耗系统框架下全系统状态控制、调频调压、底层温控等技术方案设计开发
负责SoC启动、MCU小系统控制、功耗建模等技术方案设计开发
负责全芯片时钟复位方案设计交付、特殊实现与关键IP技术迭代
支撑EDA/EMU/FPGA验证、IP/子系统功耗优化迭代与回片闭环
【课题名称】大模型负载分析和推理系统优化
【课题内容】结合端侧设备的功耗、面积和实时性限制,探索自动优化方法研究,沉淀算子、模型及应用级优化方法,识别加速最优解决方案,并能够实施自动化化优化技术研究&应用
实现计算过程中的高效协同,发挥各类计算单元的有效算力
在算力墙、内存墙、通信墙等各维度平衡取舍发挥系统综合最优性能

⭐最低要求

微电子,计算机,电子,通信,自动化相关专业
有3年以上数字电路设计经验,能使用verilog/systemverilog进行电路设计
对数字设计流程有一定了解,对相关EDA工具(VCS,DC,PTPX等)有一定掌握

👍优先资格

a. 对低功耗设计方法学有了解
b. 有功耗仿真经验
c. 有电路PPA优化经验
d. 有PMU/CRG/低功耗控制IP方面设计经验
e. 有ARM/ARC/RISCV相关轻量级处理器设计经验
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