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设计可靠性工程师-Design for Reliability Enginner(J15452)
立即应聘

设计可靠性工程师-Design for Reliability Enginner(J15452)

发布于 大约 1 小时前

普通员工/个人贡献者

上海市 / 合肥市
中级经验
全职员工
仅现场办公
本科
研究与开发 (研发)
Dfmea
Dfr
Dram
半导体
器件可靠性
失效分析
电路分析
老化仿真

AI 估算 · 15k–25k

本科3年经验，半导体大厂，薪资在行业中上水平，考虑上海和合肥的差异取合理范围。

职位详情

关于这个职位

该职位主要负责DRAM芯片的可靠性设计与分析工作，包括制定可靠性设计规则、进行老化仿真、分析产品失效机理并推动改善

适合具备器件、可靠性或电路背景的工程师，参与从器件到产品的全链条可靠性研究

最低要求

教育背景与专业知识：本科及以上学历，微电子、半导体、物理类相关专业毕业

行业与专业经验：3年及以上器件、可靠性、设计或Product工作经验，具备良好的器件、可靠性、电路或产品基础
专业技能与资格：具备DFR、电路分析或电性失效分析相关经验者优先
项目/任务成果：主导或深度参与过至少一款芯片的可靠性评估与优化项目，并产出DFR规范或失效分析报告
其他要求：具有较强分析能力，能独立完成老化仿真与失效分析，并推动改善方案落地

工作职责

可靠性需求拆解与规范制定：拆解DRAM电路对器件可靠性的需求，制定可靠性相关的design rule和spec

老化仿真与机理分析：基于aging model/ECR rule进行电路的可靠性老化仿真，分析研究相关degradation机理，驱动产线可靠性部门改善工艺
产品可靠性失效分析：统筹BI/HTOL等产品可靠性项目的失效分析，分析电路失效机理，提供改善建议并推动闭环
知识沉淀与DFMEA：调研总结DRAM可靠性关键电路、相关失效机理和改进方案，形成lesson learn和DFMEA文档
DFR规范建立与完善：建立并完善DRAM相关的DFR规范，推动可靠性设计标准化
多层级关联研究：研究并建立从器件到电路再到产品的可靠性关联，发布相关技术和学术成果

优先资格

具备DFR、电路分析或电性失效分析相关经验者优先

AI 洞察

优缺点分析

优点

  • 深耕半导体核心领域，DRAM可靠性极具技术深度，积累不可替代的经验
  • 长鑫存储作为国内存储大厂，平台大、项目多，能接触先进工艺
  • 职责涵盖从设计到量产的全链条，技能全面发展
  • 工作涉及大量仿真和失效分析，需要较强的耐心和细致度
  • 适合对半导体器件和电路可靠性有浓厚兴趣，喜欢分析问题和推动技术改进的工程师

缺点 / 挑战

  • 半导体行业节奏快，可能需要应对紧急的产品可靠性问题，有一定压力
  • 需要与多个部门（设计、工艺、测试）协调，沟通成本较高

角色解读

  • 横向发展：可在可靠性、设计、产品等方向深入，成为跨领域专家
  • 纵向晋升：从IC工程师发展为技术专家或技术带头人，带领团队
  • 行业前景：半导体可靠性是芯片良率和寿命的关键，经验稀缺，可扩展到其他芯片类型
  • 制定DRAM芯片的可靠性设计规则和spec，确保产品满足可靠性要求
  • 进行电路老化仿真，分析器件退化机理，与产线协作改善工艺
  • 主导产品可靠性测试（如BI/HTOL）的失效分析，定位电路失效原因并推动改进
  • 研究从器件到产品的多层级可靠性关联，输出技术文档和DFMEA
  • 扎实的半导体器件物理和电路基础知识，熟悉DRAM工作原理
  • 掌握可靠性仿真工具（如aging model、ECR rule）和失效分析技术
  • 具备DFR/DFMEA方法论，能独立制定可靠性规范
  • 良好的数据分析能力和项目推动能力，能跨部门沟通协作

申请策略

  • 在简历中体现你对芯片可靠性的系统性理解，从器件到产品的关联
  • 面试前了解长鑫存储的产品线与技术路线，展现你的兴趣
  • 突出参与的芯片可靠性项目，具体描述你的角色、方法和成果
  • 强调老化仿真、失效分析或DFR规范制定的经验
  • 列出掌握的EDA工具、仿真软件和失效分析设备
  • 深入学习DRAM电路架构和可靠性机理
  • 掌握SPICE仿真和可靠性建模工具，如HSPICE、RelXpert等
  • 了解JEDEC可靠性标准和DFMEA方法

面试指南

  • STAR法则：情境、任务、行动、结果，清晰展示项目经验
  • 原理+实例：先解释理论基础，再结合具体项目说明你的做法
  • 结构化思考：从器件到电路再到产品，分层分析问题
  • DRAM中常见的可靠性失效模式有哪些？如何改善？
  • 请描述一次你主导可靠性评估项目的经历，遇到什么挑战？
  • 老化仿真的原理是什么？如何设置仿真条件？
  • 如何从电路设计角度预防ESD或NBTI退化？
  • 你如何制定一个芯片的可靠性测试计划？

职位点评

71
综合评分

半导体大厂技术岗，前沿可靠性方向，成长性高但WLB一般。

从薪资福利、成长空间、工作节奏和岗位方向综合评估，方便横向比较。

更适合这类人
适合追求技术深度和职业成长，能接受现场办公和一定工作压力的求职者。
表现最好
成长发展
相对薄弱
工作生活
薪资福利70
成长发展85
工作生活50
使命价值75

薪资福利

70中等

该职位薪资在行业中等偏上，且为大型半导体公司，稳定性较好，但未明确提及具体福利。

薪资信号未披露（AI估算：15K-25K/月）

成长发展

85较高

职位涉及先进DRAM可靠性技术，深度参与全链条，技能成长空间大，但未明确提及培训或晋升路径。

技术前沿前沿/新兴技术
技术栈DRAM、老化仿真、DFR、DFMEA、电路分析
业务类型profit_center

工作生活

50较低

仅现场办公，上海/合肥工作，未提及弹性工作或WLB信息，可能有一定加班压力。

工作模式仅现场办公
办公地点科技园/产业园
加班情况未提及（无法判断）

使命价值

75中等

半导体行业属于国家战略新兴产业，DRAM国产化有重要意义，但JD未强调社会使命。

行业发展高速增长赛道
社会影响中性/一般
创新程度积极采用新技术

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