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小米
芯片设计工程师

芯片设计工程师

发布于 大约 9 小时前

普通员工/个人贡献者

深圳市
中级经验
全职员工
仅现场办公
硕士
芯片设计
Cmos
Eda
Rtl
Systemverilog
数字电路
时序分析
芯片流片

AI 估算 · 25k–45k

芯片设计领域人才稀缺,薪资水平较高,小米平台大,深圳地区增幅明显。

职位详情

关于这个职位

该职位负责数模芯片的前端设计工作,包括RTL编码、综合、时序收敛,参与数字电路仿真验证,协同后端团队完成物理实现,并支持量产测试

适合对数字芯片设计有热情、具备微电子或集成电路背景的工程师

最低要求

硕士研究生及以上学历,专业背景包括微电子、集成电路设计、电子工程、计算机等相关领域

具有数字芯片设计经验,熟悉Verilog/SystemVerilog RTL编码
掌握Synopsys Cadence等EDA工具的使用
了解CMOS工艺基础、时序分析与功耗优化方法
有良好的沟通能力、分析问题能力以及团队合作意识

工作职责

负责数模芯片的前端设计,包括RTL编码、综合、时序收敛等

进行数字电路的仿真验证,确保功能正确性与时序要求
协同后端团队完成物理实现,参与布局布线审查
支持芯片量产测试,制定测试方案并分析测试数据
研究先进工艺下的数字设计方法学,推动设计流程优化

优先资格

具有芯片设计实习或流片经验者优先

AI 洞察

优缺点分析

优点

  • 芯片设计是半导体行业的核心岗位,技术含金量高,职业稳定性强
  • 小米作为大厂,资源丰富,有机会参与先进工艺节点项目,积累流片经验
  • 岗位需求旺盛,薪资水平具有竞争力,长期发展前景好
  • 芯片设计专业门槛高,需要扎实的理论基础和长期学习
  • 技术迭代快,需持续跟进先进工艺与设计方法学
  • 适合对芯片设计有强烈兴趣,愿意深耕数字前端技术,并具备扎实微电子功底的求职者

缺点 / 挑战

  • 项目周期长,流片压力大,可能存在高强度加班

角色解读

  • 从模块设计到芯片级架构,逐步承担更复杂的设计任务
  • 可向设计验证、DFT、物理设计或架构师方向发展
  • 随着经验积累,可晋升为技术专家或团队管理者
  • 负责数模混合芯片的数字前端设计,编写RTL代码并进行综合与时序收敛
  • 执行数字电路的仿真验证,确保功能正确性并满足时序要求
  • 与后端团队协作,参与布局布线审查,确保物理实现符合设计目标
  • 支持芯片量产测试,制定测试方案,分析测试数据以优化良率
  • 扎实的数字电路基础,熟练掌握Verilog/SystemVerilog RTL编码
  • 熟悉Synopsys、Cadence等主流EDA工具链的使用
  • 理解CMOS工艺、时序分析和功耗优化方法
  • 具备良好的沟通能力和团队协作意识,能够跨团队推进工作

申请策略

  • 提前了解小米芯片部门的产品方向(如SoC、ISP等),在面试中展现匹配度
  • 准备好项目讲解,尽量用数据量化设计成果(如面积、功耗、性能改善)
  • 突出数字电路设计项目经验,特别是流片或实际tape-out经历
  • 详细描述RTL编码、验证、综合方面的具体工作和技术成果
  • 强调使用过的EDA工具和掌握的技能,如Synopsys/Cadence流程
  • 展示解决时序收敛、功耗优化等问题的实际案例
  • 巩固Verilog/SystemVerilog编程,熟悉UVM验证方法学
  • 学习STA(静态时序分析)和低功耗设计技巧

面试指南

  • 用STAR法则(情境-任务-行动-结果)组织项目经历,突出个人贡献和量化结果
  • 对于技术问题,先阐述基础原理,再结合项目实际案例说明应用和权衡
  • 展示解决问题的能力:分析问题、提出方案、验证结果、总结反思
  • 请介绍一个你参与的数字芯片设计项目,你的具体职责是什么?
  • 如何确保RTL设计满足时序要求?请谈谈你的时序收敛方法
  • 遇到过功耗优化问题吗?你是如何解决的?
  • 解释一下亚稳态的概念,如何避免?
  • 你对先进工艺下的设计方法学有哪些了解?

职位点评

69
综合评分

高成长、高薪资、技术前沿,但工作强度较大,生活平衡一般。

从薪资福利、成长空间、工作节奏和岗位方向综合评估,方便横向比较。

更适合这类人
该职位最适合追求技术深度和职业成长、愿意投入高强度工作的求职者,对工作与生活平衡要求较高者需谨慎考虑。
表现最好
成长发展
相对薄弱
工作生活
薪资福利70
成长发展85
工作生活50
使命价值65

薪资福利

70中等

小米作为上市大厂,薪资水平在行业中具有竞争力,但JD未明确薪资和福利,具体待遇存在不确定性。

薪资信号未披露(AI估算:25K-45K/月)

成长发展

85较高

芯片设计技术含量高,涉及先进工艺和完整流片流程,个人技能成长空间大,职业路径清晰。

技术前沿前沿/新兴技术
技术栈Verilog、SystemVerilog、RTL、EDA、CMOS、时序收敛、功耗优化
业务类型ambiguous

工作生活

50较低

工作地点在深圳,仅现场办公,JD未提及弹性工时或远程,芯片行业项目紧张时可能加班,生活平衡一般。

工作模式仅现场办公
办公地点未明确
加班情况未提及(无法判断)

使命价值

65中等

芯片设计对国家半导体产业具有重要意义,但JD未直接强调使命愿景,个人获得感更多来自技术成就。

行业发展高速增长赛道
社会影响中性/一般
创新程度积极采用新技术
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