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芯片低功耗设计专家-Low-Power Design Expert(J19880)
立即应聘

芯片低功耗设计专家-Low-Power Design Expert(J19880)

发布于 大约 1 小时前

普通员工/个人贡献者

合肥市 / 西安市
专家级经验
全职员工
仅现场办公
硕士
硬件工程
Design Compiler
Dram
Finesim
Power Gating
Ptpx
Vcs
低功耗设计
功耗仿真
Clock Gating

AI 估算 · 30k–60k

资深芯片设计专家，5年以上经验，存储行业需求大，薪资竞争力强，综合一二线城市水平估算。

职位详情

关于这个职位

这份职位面向资深芯片设计专家，聚焦DRAM产品的低功耗设计与优化

你将参与制定低功耗策略、实现内电压调控与Power Gating等关键技术，并进行功耗建模与仿真
适合有5年以上数字/模拟电路设计经验、熟悉VCS/DC/PTPX等EDA工具、对存储芯片功耗优化有深入理解的工程师
工作地点覆盖合肥、西安、上海、北京，加入国内领先的存储器制造商

最低要求

教育背景与专业知识：硕士及以上学历，微电子、计算机、电子、通信相关专业毕业

行业与专业经验：5年以上数字或模拟电路设计经验，有在知名存储芯片企业或半导体研发机构工作经历者优先
专业技能与资格：了解全定制设计流程，能使用VCS、DC、PTPX、finesim等EDA工具完成功耗分析与仿真
项目/任务成果：主导或深度参与过至少一款芯片的低功耗设计与优化项目，具备以下至少两项经验：低功耗设计方法学研究、DRAM或SOC功耗仿真、电路PPA优化、低功耗控制IP设计、SOC系统功耗分析与拆解
其他要求：具有较强跨部门协作与沟通能力，能主动跟踪技术前沿并转化为产品竞争力

工作职责

低功耗策略制定：参与DRAM产品低功耗整体策略制定，包括功耗分析、设计方案、工艺协同及系统功耗优化拆解

低功耗设计开发：负责DRAM产品低功耗设计开发，包括内电压调控、分电压域调控、power gating、CLK gating等关键技术方案的设计与实现
功耗建模与仿真：负责DRAM产品功耗系统性建模，完成JEDEC Spec功耗要求分析及特定系统场景下的功耗仿真
跨部门协同优化：与DRAM测试及SOC系统团队紧密合作，分析DRAM产品的功耗优化方向，推动设计开发方案落地
行业跟踪与竞品研究：密切关注全球DRAM功耗方面技术发展动态、市场趋势及竞争对手产品表现，输出技术预判与研发建议

优先资格

有在知名存储芯片企业或半导体研发机构工作经历者优先

AI 洞察

优缺点分析

优点

  • 存储芯片是半导体核心赛道，长鑫存储作为国内DRAM龙头，平台优势明显
  • 低功耗设计是芯片设计的关键方向，技术含量高，个人价值提升快
  • 工作地点多选，可灵活选择合肥、西安、上海、北京等城市
  • 职位级别高，有机会参与先进工艺节点的产品开发
  • 对专业深度要求极高，需要5年以上经验且精通多种EDA工具
  • 跨部门协同多，需要较强的沟通和推动能力
  • 半导体行业周期性明显，可能面临市场波动
  • 适合有5年以上芯片设计经验、热爱低功耗技术、希望在存储领域深耕的资深工程师

缺点 / 挑战

  • DRAM产品迭代快，功耗要求严苛，工作压力可能较大

角色解读

  • 成为芯片低功耗设计领域的资深专家，主导下一代DRAM产品的功耗架构
  • 向技术管理方向发展，带领低功耗设计团队，或转向系统级功耗架构师
  • 在存储行业跨度发展，可向AI芯片、移动SoC等高功耗敏感领域拓展
  • 负责DRAM产品的低功耗策略制定，分析功耗需求并拆解系统功耗优化目标
  • 设计并实现内电压调控、Power Gating、CLK Gating等低功耗关键技术方案
  • 建立功耗模型，使用EDA工具进行JEDEC规范下的功耗仿真与分析
  • 与测试和SOC团队协作，推动功耗优化方案的落地，并跟踪行业技术动态
  • 扎实的数字/模拟电路设计基础，熟悉全定制设计流程
  • 熟练使用VCS、DC、PTPX、Finesim等EDA工具进行功耗分析与仿真
  • 具备低功耗设计方法论或DRAM/SOC功耗仿真经验，了解PPA优化
  • 较强的跨部门协作与沟通能力，能推动技术方案落地

申请策略

  • 提前了解长鑫存储的DRAM产品线和低功耗技术路线，在面试中展示匹配度
  • 准备好技术预判和竞品分析思路，体现行业视野
  • 突出主导或深度参与的芯片低功耗设计项目，说明具体方案和量化成果
  • 强调对EDA工具（VCS/DC/PTPX等）的实际应用经验和熟练程度
  • 列出与DRAM或SOC功耗相关的专利、论文或技术报告，体现专业深度
  • 展示跨部门协作和项目推动的案例，说明沟通能力
  • 补充学习JEDEC DRAM功耗规范，加深对标准要求的理解
  • 熟悉更先进的低功耗技术，如DVFS、自适应电压调节等

面试指南

  • 采用STAR法则：情境-任务-行动-结果，突出个人贡献和量化收益
  • 对于技术问题，先阐述原理，再结合项目经验说明具体做法和教训
  • 对于协作问题，强调沟通机制和冲突解决，体现团队意识
  • 请介绍你主导的一个低功耗设计项目，从策略制定到落地的完整过程
  • 你如何分析DRAM产品在不同场景下的功耗？使用过哪些工具？
  • 内电压调控和Power Gating的实现中有哪些挑战？如何解决？
  • 如何与测试团队和SOC团队协同优化系统功耗？
  • 请谈谈你对当前DRAM低功耗技术趋势的理解

职位点评

70
综合评分

高技术水平、成长空间大，但加班与工作方式不明确

从薪资福利、成长空间、工作节奏和岗位方向综合评估，方便横向比较。

更适合这类人
适合追求技术深度和职业成长的资深芯片工程师，对工作地点灵活性要求不高。
表现最好
成长发展
相对薄弱
工作生活
薪资福利70
成长发展88
工作生活50
使命价值65

薪资福利

70中等

职位未披露具体薪资，但资深芯片专家通常薪酬较高，且长鑫存储作为知名企业提供稳定福利。

薪资信号未披露（AI估算：30K-60K/月）

成长发展

88较高

低功耗设计属于半导体前沿技术，职位要求深耕技术，成长空间大，但JD未明确晋升路径。

技术前沿前沿/新兴技术
技术栈DRAM、Low-Power Design、Power Gating、Clock Gating、VCS、DC、PTPX、Finesim
业务类型ambiguous

工作生活

50较低

仅现场办公，工作地点可选但未提及弹性或远程，WLB信号缺失。

工作模式仅现场办公
办公地点未明确
加班情况未提及（无法判断）

使命价值

65中等

存储芯片对数字经济有基础性价值，但JD未强调社会使命，行业处于成熟期。

行业发展稳定成熟行业
社会影响中性/一般
创新程度积极采用新技术

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