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电性失效分析研发工程师 -Electrical Failure Analysis Engineer(J20178)
立即应聘

电性失效分析研发工程师 -Electrical Failure Analysis Engineer(J20178)

发布于 大约 15 小时前

普通员工/个人贡献者

合肥市 / 北京市
中级经验
全职员工
仅现场办公
本科
研究与开发 (研发)
Advantest
Dram
Pfa
半导体
失效分析
封装工艺
晶圆制造
电路图
示波器

AI 估算 · 20k–35k

半导体行业技术岗，硕士以上学历，需掌握电性分析技能，市场薪资较高。

职位详情

关于这个职位

该职位主要负责DRAM芯片及封装产品的电性失效分析，需要制定分析方案、操作专业测试设备、定位故障模式，并与多部门协作推动质量改善

适合具备半导体物理基础知识、熟悉电性分析工具、有志于深耕半导体失效分析领域的工程师

最低要求

教育背景与专业知识：全日制本科及以上学历，微电子/半导体物理等理工科专业，具备半导体器件物理与集成电路基础

专业技能与资格：能操作ADVANTEST、示波器等电性分析设备，能独立完成测试方案设计与数据解析，能读懂电路图及PCB版图者优先
行业与专业经验：熟悉晶圆制造工艺或封装工艺，有集成电路产业电性失效分析或产品测试经验者优先，有芯片EFA和PFA经验者优先
其他要求：具有结构化的分析解决问题能力，能跨团队协作推动失效分析项目闭环并及时输出技术报告

工作职责

主导DRAM芯片及封装产品的电性失效分析，制定逻辑完善的失效分析方案，输出系统性分析报告

基于ADVANTEST机台Memory测试功能，制定并优化测试方案，深入分析测试数据定位故障模式
执行静态与动态电性失效分析，依据故障模式通过电性分析与验证，精确定位可能的故障物理位置
通过电路布局追踪与分析，建立失效隔离位置与故障模式之间的关联性，驱动设计或制程改善
与设计、制造、测试、品保等部门协同，推动产品质量提升，对内外部人员开展电性分析技术培训

优先资格

能读懂电路图及PCB版图者优先

有集成电路产业电性失效分析或产品测试经验者优先
有芯片EFA和PFA经验者优先

AI 洞察

优缺点分析

优点

  • 进入半导体晶圆制造核心环节，技术壁垒高，经验积累价值大
  • 公司为国产存储龙头，平台稳定，有行业前景
  • 工作内容涉及多部门协作，能快速提升跨领域沟通和项目管理能力
  • 失效分析需要较强的逻辑推理和耐心，问题定位有时较困难
  • 需要掌握多种设备与分析方法，学习曲线较陡
  • 适合对半导体物理有热情、喜欢逻辑推理和动手实验的理工科人才，尤其适合希望在芯片良率提升领域深耕的工程师

缺点 / 挑战

  • 半导体行业节奏快，部分项目可能存在时间压力

角色解读

  • 可以从失效分析工程师成长为技术专家，深入半导体制造良率提升领域
  • 也可转向设计或测试相关岗位，积累全流程经验后晋升为团队主管或项目负责人
  • 长期可发展为半导体行业资深顾问或质量管理者
  • 你需要主导DRAM芯片的电性失效分析，制定测试方案并操作ADVANTEST等设备定位故障
  • 通过数据分析与电路追踪，找到失效的物理位置并给出改善建议
  • 与设计、制造、测试等部门协作，推动产品质量提升并提供技术培训
  • 扎实的半导体器件物理与集成电路基础
  • 熟练操作ADVANTEST、示波器等电性分析设备，能独立设计测试方案
  • 具备数据分析能力和电路图阅读能力，有晶圆工艺或封装工艺知识

申请策略

  • 面试中准备一个具体的失效分析案例，展示结构化思维
  • 关注公司产品和工艺方向，表明对存储芯片行业的兴趣
  • 突出半导体器件物理、集成电路相关课程或项目经历
  • 强调使用ADVANTEST、示波器等设备的经验，以及失效分析案例
  • 体现数据分析、报告撰写和跨团队协作能力
  • 可提前学习DRAM架构和测试原理，熟悉Memory测试流程
  • 练习电路图阅读和PCB版图软件（如Cadence）
  • 了解晶圆制造和封装工艺的基本流程

面试指南

  • 用STAR法则描述案例：情境-任务-行动-结果，突出逻辑和系统性
  • 技术问题：先定义问题，再分步骤分析，最后总结验证
  • 协作问题：强调沟通、数据驱动、持续跟进
  • 请描述一次你主导的失效分析过程，你是如何定位故障的？
  • 如何操作ADVANTEST机台进行Memory测试？测试方案如何设计？
  • DRAM常见的失效模式有哪些？如何区分电性和物理失效？
  • 在跨部门协作中，遇到推动困难时你如何处理？
  • 请解释一种半导体器件物理现象（如PN结击穿）并说明其与失效的关系

职位点评

71
综合评分

半导体大厂技术岗，前沿失效分析方向，薪资面议，发展空间大但需现场办公。

从薪资福利、成长空间、工作节奏和岗位方向综合评估，方便横向比较。

更适合这类人
该职位最适合发展动机强烈的求职者，希望在半导体技术领域深入成长，对WLB要求不高。
表现最好
成长发展
相对薄弱
工作生活
薪资福利70
成长发展85
工作生活50
使命价值75

薪资福利

70中等

该职位薪资在行业中具有竞争力，公司为国有背景，福利保障较好，但具体薪资需面议，且未明确提及年终奖等细节。

薪资信号面议 (20K-35K/月)

成长发展

85较高

岗位涉及先进DRAM芯片失效分析，技术前沿，能积累半导体核心技能，成长空间大，但JD未明确提及培训或晋升通道。

技术前沿前沿/新兴技术
技术栈DRAM、电性失效分析、ADVANTEST、半导体、封装
业务类型profit_center

工作生活

50较低

工作地点在合肥或北京，需要现场办公，未提及弹性工作或远程，半导体行业可能存在一定加班强度。

工作模式仅现场办公
办公地点科技园/产业园
加班情况未提及（无法判断）

使命价值

75中等

半导体行业属于国家重点发展领域，国产存储突破具有社会价值，但JD未直接强调使命感。

行业发展高速增长赛道
社会影响正向社会影响力较高
创新程度积极采用新技术

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