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PMU ASIC Engineer - New College Graduate 2027
PMU ASIC Engineer - New College Graduate 2027
发布于 2 小时前普通员工/个人贡献者
全职员工仅现场办公芯片设计
芯片设计
Dvfs
Risc-V
Rtl设计
低功耗设计
热管理
芯片架构
英语沟通
值不值得投
81综合评分
综合评分 81
顶尖芯片厂校招、前沿低功耗技术栈、成长空间广阔，需适应研发节奏与高强度学习
从薪资福利、成长发展、工作生活和使命价值四个维度综合评估，方便比较职业起点。
薪资怎么样
3.3万
比芯片设计中位数高
发布情况
新岗位 · 今天发布
公司情况
这家公司招聘很活跃
约 430 个在招 · 其中芯片设计 28 个
市场机会
选择面较广
上海 · 芯片设计 · 约 460 个在招
职位详情
关于这个职位
本职位面向2027届应届生，主要负责下一代数据中心、GeForce及汽车芯片的电源管理单元(PMU)微架构设计与RTL编码
候选人将参与芯片全流程签核，并与架构及软件团队紧密协作，持续优化芯片在各类负载下的能效表现
最低要求
电子工程、微电子或集成电路工程专业的学士或硕士学位
具备出色的沟通能力，英语口语熟练（因需频繁与美国和印度外部团队沟通）
熟悉前端ASIC设计
工作职责
将微架构实现为RTL设计
负责每个里程碑的一般芯片签核清单处理
参与与架构成员甚至软件成员的讨论，以明确需求动机
优先资格
具有热管理、主动功耗或低功耗设计经验（如NAFLL ADC、AVFS、DVFS、PG/RG/CG等）
在系统级控制功能方面扮演过类似角色（不限于功耗相关）
AI 洞察
优缺点分析
优点
- 依托英伟达顶尖GPU生态平台，接触业界最前沿的AI芯片研发
- 技术栈聚焦高价值低功耗设计，行业稀缺性强
- 完善的校招培养体系与国际化工作环境
- 对专业基础与英语实战能力要求极高，初期学习曲线陡峭
- 适合集成电路相关专业背景扎实、对底层硬件设计有浓厚兴趣、具备良好英语沟通能力且追求技术深度的应届毕业生
缺点 / 挑战
- 芯片研发周期长、流程严谨，需应对严格的签核节点压力
角色解读
- 可向资深芯片架构师、PMU/IP负责人方向发展
- 积累完整流片经验后，可拓展至更复杂的SoC电源管理或系统级芯片设计领域
- 负责电源管理单元(PMU)的微架构设计与RTL代码实现
- 跟进芯片开发各阶段的签核流程
- 跨部门协作优化芯片功耗与性能表现
- 扎实的集成电路/微电子专业基础
- 熟练掌握前端ASIC设计与RTL编码
- 优秀的英语听说读写能力以适应跨国团队沟通
- 了解低功耗技术与系统级控制机制
申请策略
- 提前研究英伟达最新GPU架构中的电源管理方案
- 准备英文自我介绍与技术项目陈述
- 关注公司校招时间节点与线上测评安排
- 突出集成电路/微电子相关课程成绩与项目经历
- 详细列出参与的ASIC/FPGA设计实践、低功耗技术实验或科研课题
- 强调英语证书或海外交流/合作经验
- 深入复习数字电路、计算机体系结构及低功耗设计原理
- 熟悉主流EDA工具链（如Vivado, Synopsys VCS）
面试指南
- 采用STAR法则结构化描述项目背景、任务、行动与结果
- 技术类问题先阐明原理，再结合具体案例说明实现路径与验证方法
- 跨团队协作问题强调沟通机制、文档记录与妥协/折中方案
- 请介绍你参与过的一个完整数字电路设计项目及其难点
- 如何理解并实现低功耗设计（如DVFS/时钟门控）？遇到功耗超标如何排查？
- 请用英语简述你的毕业设计或科研项目
- 如果架构需求与RTL实现存在冲突，你会如何协调？
- 梳理核心专业课知识点，重点复习时序分析、低功耗技术及接口协议
职位点评
薪资福利85
成长发展92
工作生活60
使命价值75
薪资福利
85较高
起薪对标上海集成电路行业应届生标准，整体薪酬结构稳健，但具体福利细节未在JD中披露。
薪资信号市场水准 (2.5千–4.0万/月)
成长发展
92较高
岗位聚焦电源管理单元核心模块研发，技术栈贴近业界主流现代标准，具备完整的芯片流片与迭代经验积累机会。
技术前沿前沿/新兴技术
技术栈RTL设计、前端ASIC、低功耗设计、RISC-V、DVFS
业务类型profit_center
工作生活
60中等
JD未明确提及具体办公模式与工时安排，硬件研发岗位通常需配合项目节点推进，实际工作节奏以HR沟通为准。
工作模式未明确
办公地点科技园/产业园
加班情况未提及（无法判断）
使命价值
75中等
致力于提升算力能效比，推动数据中心与自动驾驶等领域的绿色高效发展，具有显著的行业技术引领价值。
行业发展高速增长赛道
社会影响正向社会影响力较高
创新程度积极采用新技术
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