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AMD logo
超威半导体
Silicon Design Engineer
立即应聘

Silicon Design Engineer

发布于 大约 13 小时前

普通员工/个人贡献者

上海市
中级经验
全职员工
仅现场办公
硕士
硬件工程
SystemVerilog
ASIC
TCL
UPF
IP集成

AI 估算 · 25k–40k

硕士3年经验+AMD平台,上海芯片设计薪资中位数约3万,考虑上市大公司福利和加班情况。

职位详情

关于这个职位

作为AMD上海团队的硅设计工程师,你将参与从高级设计到综合、布局布线、时序和功耗的全流程ASIC开发

你将负责模块接口定义、仿真以及设计集成,与全球团队合作,推动下一代计算体验的硬件实现
适合有扎实ASIC前端设计经验、熟悉SystemVerilog和脚本语言的工程师

最低要求

硕士学历(电子/计算机工程或同等学历),至少3年软件开发的动手设计集成经验

熟悉SystemVerilog HDL编码和ASIC前端实现流程
熟悉Unix/Linux和脚本语言(TCL, Ruby, Perl, Python等)
熟悉IP构建,包括时序、UPF、综合
较强的任务组织能力
良好的人际交往能力(口头和书面)
强烈的成就和职业发展热情
自主的团队合作者

工作职责

负责ASIC开发的总体定义、设计、集成和文档

为仿真定义模块接口/格式
评估从高级设计到综合、布局布线、时序和功耗的流程各方面
可能审查供应商的开发能力

AI 洞察

优缺点分析

优点

  • AMD作为半导体巨头,技术平台先进,产品覆盖AI、数据中心等高增长领域
  • 岗位涉及完整ASIC设计流程,能积累全链条经验,技术深度和广度兼备
  • 上海团队与全球协作,有机会参与前沿项目,提升国际视野
  • 公司文化强调创新和包容,提供职业发展支持
  • 需要同时掌握多种技能(前端设计、脚本、IP集成),学习曲线较陡
  • 跨国协作存在时差,需灵活安排工作时间
  • 适合有至少3年ASIC设计经验、热爱技术细节、能适应高强度团队协作的工程师

缺点 / 挑战

  • 芯片设计周期长、要求高,工作压力可能较大,尤其在流片节点

角色解读

  • 晋升为高级设计工程师或技术专家,深入芯片架构或特定领域
  • 转向设计方法论或CAD团队,成为工具流程专家
  • 积累经验后向技术管理方向发展,带领设计团队
  • 负责ASIC项目的整体定义、设计和集成,确保从高级设计到物理实现的全流程顺畅
  • 定义模块接口和仿真格式,协调设计与验证团队的工作
  • 评估并优化设计流程,包括综合、布局布线、时序和功耗分析
  • 与全球团队合作,参与设计方法论和技术的制定
  • 扎实的SystemVerilog和ASIC前端设计经验,熟悉综合、时序、UPF等
  • 精通Unix/Linux环境及脚本语言(TCL, Ruby, Perl, Python),能自动化流程
  • 良好的团队协作和沟通能力,能够与多国团队高效合作
  • 较强的逻辑思维和问题解决能力,能独立推进任务

申请策略

  • AMD注重文化匹配,面试中强调创新、协作和成就导向
  • 可提前通过LinkedIn联系内部员工了解团队具体工作,展现主动性
  • 突出ASIC前端设计项目经验,尤其是参与完整流程(从RTL到GDS)的案例
  • 强调脚本自动化能力,列出具体用Python/Perl/TCL解决的问题
  • 展示跨团队协作经验,特别是与海外团队的合作
  • 提及任何与IP集成、时序收敛或UPF相关的成果
  • 深入复习SystemVerilog语法和验证方法学,准备RTL编码面试题
  • 练习常见脚本语言的问题解决,如用Python写自动化脚本

面试指南

  • 用STAR法则(情境、任务、行动、结果)回答问题,突出技术细节和你的贡献
  • 对于技术问题,先给出定义或原理,然后结合项目实例说明
  • 展示解决问题的思路,包括如何分析、尝试和验证
  • 请介绍你参与过的一个ASIC设计项目,从RTL到流片的流程
  • 如何处理setup和hold时序违例?举例说明
  • 解释UPF在低功耗设计中的作用,并描述一个实际应用场景
  • TCL或Python脚本中如何解析一个大型log文件并提取关键信息?
  • 与海外团队合作时,如何协调不同时区的工作?

匹配度报告

71
综合匹配度

技术驱动、发展前景好,但工作强度可能较大,现场办公。

适合人群
适合追求技术深度和职业成长、对高强度工作有准备的工程师。
最强匹配
成长发展匹配
最弱匹配
工作生活匹配
薪资福利80
成长发展85
工作生活50
使命价值70

薪资福利匹配

80较高

薪资水平在上海属于中上,但未明确具体数字;AMD上市大公司福利较好,但JD未详细列出。

薪资信号未披露(AI估算:25K-40K/月)

成长发展匹配

85较高

岗位涉及完整ASIC设计流程,技术含量高;AMD鼓励创新和职业发展,但JD未明确培训或晋升路径。

技术前沿主流现代技术
技术栈SystemVerilog、ASIC、UPF、Synthesis
业务类型profit_center

工作生活匹配

50较低

未提及远程办公或弹性时间,芯片设计通常需要现场工作,且可能有较强的工作强度。

工作模式仅现场办公
办公地点未明确
加班情况未提及(无法判断)

使命价值匹配

70中等

半导体行业高速增长,AMD在AI和计算领域举足轻重,工作有技术成就感,但社会直接影响力一般。

行业发展高速增长赛道
社会影响中性/一般
使命信号build great products that accelerate next-generation computing experiences
创新程度积极采用新技术
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