
长鑫存储
DRAM设计验证工程师-DRAM Design Verification Engineer(J21742)
DRAM设计验证工程师-DRAM Design Verification Engineer(J21742)
发布于 41 分钟前普通员工/个人贡献者
全职员工仅现场办公半导体封装测试
半导体封装测试
Cmos
Dram
Eda Tools
Systemverilog
Uvm
Virtuoso
值不值得投
76综合评分
综合评分 76
国产存储龙头核心研发岗,技术含量高,发展前景好,适合追求技术深度的工程师
从薪资福利、成长发展、工作生活和使命价值四个维度综合评估,方便横向比较。
薪资怎么样
3.3万
比半导体封装测试中位数低
发布情况
新岗位 · 今天发布
公司情况
这家公司招聘很活跃
约 1970 个在招 · 其中半导体封装测试 9 个
市场机会
选择不多
合肥 · 半导体封装测试 · 8 个在招
职位详情
关于这个职位
负责DRAM芯片全层级及模块级的电路设计验证,搭建验证平台并开发行为模型与检查器
制定测试计划,分析覆盖率缺口,并为设计团队提供调试支持,确保芯片功能与时序符合规格要求
最低要求
教育背景与专业知识:硕士及以上学历,微电子、集成电路或相关专业毕业,具备CMOS电路设计的基础知识
专业技能与资格:能使用Spectre、finesim、Virtuoso、Verilog等EDA工具完成电路仿真与验证,能使用UVM、SystemVerilog、VPI/PLI及断言编码进行功能验证
行业与专业经验:具备LPDDR4 DRAM产品验证经验者优先
项目/任务成果:主导或深度参与过至少一款存储器芯片的全芯片或模块级验证工作,包括验证平台搭建与覆盖率收敛
其他要求:具有良好的团队协作与沟通能力,学习能力强,能在灵活、动态的环境中保持自驱力
工作职责
全芯片与模块级验证:主导芯片全层级及模块级电路设计验证,确保设计功能与时序符合规格要求
验证平台搭建:开发验证平台,包括测试环境构建与回归测试系统建设,推动验证效率与覆盖率的持续提升
行为模型与检查器开发:基于存储器架构与功能,开发行为模型、断言、检查器及监视器,强化验证的可观测性
测试规划与覆盖率分析:制定测试计划并验证设计功能,运行覆盖率和回归测试,分析覆盖率缺口并制定多样化策略填补漏洞
设计调试支持:为设计团队提供电路调试支持,推动问题定位与解决
AI 洞察
优缺点分析
优点
- 身处国产存储芯片龙头,技术壁垒高,职业发展空间大
- 微电子/集成电路专业硕士,对硬件验证有热情,具备较强逻辑思维和抗压能力者
缺点 / 挑战
- 芯片验证工作细致繁琐,对细节要求极高,需应对严格的流片节点压力
角色解读
- 可向高级验证工程师、验证专家或验证经理方向发展,也可转向芯片架构师角色
- 负责DRAM芯片从模块到全芯片级别的电路验证,确保设计无误
- 精通SystemVerilog/UVM验证方法学,熟悉主流EDA工具(Spectre/Virtuoso),具备CMOS电路基础
申请策略
- 关注长鑫存储的最新技术动态,准备针对DRAM特性的验证案例问答
- 突出参与的存储器芯片验证项目,强调覆盖率提升和问题定位的具体成果
- 深入理解UVM架构,复习CMOS模拟/数字电路基础知识,熟悉LPDDR协议
面试指南
- 使用STAR法则(情境、任务、行动、结果)描述项目经历,重点突出技术难点和你的解决方案
- 请描述你搭建过的最复杂的验证平台架构
- 如何在验证中提高代码覆盖率?遇到覆盖率瓶颈如何解决?
- SystemVerilog中的断言(Assertion)有哪些应用场景?
- 请解释UVM中Component和Transaction的关系
- 复习数字集成电路验证经典教材,梳理过往项目中遇到的Bug及其根因分析过程
职位点评
薪资福利80
成长发展85
工作生活60
使命价值75
薪资福利
80较高
作为C轮后超大型企业,提供具有竞争力的薪资和稳定的职业发展平台,福利体系完善。
薪资信号未披露(AI估算:2.5千–4.0万/月)
成长发展
85较高
涉及前沿的DRAM设计与验证技术,技术栈先进,有助于积累高价值的行业经验。
技术前沿前沿/新兴技术
技术栈DRAM、UVM、SystemVerilog、Verilog、Spectre、Virtuoso、CMOS
业务类型profit_center
工作生活
60中等
半导体行业通常工作强度较大,虽提及灵活环境,但核心研发岗位往往面临项目节点压力。
工作模式未明确
办公地点科技园/产业园
加班情况未提及(无法判断)
使命价值
75中等
加入国产存储芯片领军企业,对国家半导体自主可控战略有重要贡献,社会价值显著。
行业发展高速增长赛道
社会影响正向社会影响力较高
创新程度积极采用新技术
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