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达摩院-SOC高速接口验证专家-RISC V及生态
达摩院-SOC高速接口验证专家-RISC V及生态
发布于 大约 14 小时前普通员工/个人贡献者
全职员工仅现场办公芯片设计
芯片设计
Cxl
Pcie
Risc-V
Soc验证
Systemverilog
Ucie
Uvm
Gmac
值不值得投
75综合评分
综合评分 75
达摩院芯片验证专家岗，前沿技术栈，薪资高，但WLB未知。
从薪资福利、成长空间、工作节奏和岗位方向综合评估，方便横向比较。
薪资怎么样
55K
比芯片设计中位数高
发布情况
新岗位 · 今天发布
公司情况
这家公司招聘很活跃
约 1580 个在招 · 其中芯片设计 58 个
市场机会
选择适中
杭州 · 芯片设计 · 26 个在招
职位详情
关于这个职位
该职位负责阿里巴巴达摩院SOC级高速接口验证工作，重点关注PCIe/CXL/UCIE等高速总线协议，需要构建验证环境、编写测试用例、收集覆盖率，并协同设计工程师进行调试
你将深度参与RISC-V及生态相关芯片验证，接触前沿Chiplet技术，是技术含量极高的IC验证专家岗位
最低要求
电子，通信或计算机本科及以上学历
精通芯片验证语言、流程以及验证方法学，如SystemVerilog, UVM等
精通C/C++等面向对象语言;
精通Synopsys或Cadence仿真和调试工具，熟练使用各类VIP, 比如CHI/ACE/AXI, PCIE, UCIE等VIP
精通其中一个或多个高速总线协议：PCIe/CXL/UCIE/GMAC等，具有丰富总线协议的验证经验，包括IP level验证或者SOC集成验证
特别是UCIE/PCIE的总线验证，熟练掌握UCIE/PCIE controller和PHY的领域知识
具备总线一致性，流控，Chiplet，跨DIE，跨Chip等方面验证经验
具有良好的团队合作和创业精神，能独立思考和解决问题，有责任心和上进心
工作职责
负责子系统级以及SOC级的IP集成验证:
a. 负责制定验证策略，提取验证特性，完成验证计划
b. 负责搭建验证环境，创建并调试验证用例，收集并分析代码和功能覆盖率，完成网表级仿真
c. 负责验证Signoff工作，保证高速总线子系统的质量
d. 承担高速总线在EMU平台上系统大压力和场景验证，例如，跨DIE一致性，P2P, P2M等复杂压力场景的验证
协同芯片设计工程师，共同完成debug工作
AI 洞察
优缺点分析
优点
- 涉及RISC-V、Chiplet等前沿技术，技术含金量高，处于半导体行业风口
- 达摩院平台资源丰富，能与顶尖工程师协作，个人成长迅速
- 薪资待遇优厚，阿里巴巴大厂背景为职业履历增色
- 验证工作强度大，尤其在项目交付阶段可能需要加班
- 芯片验证属于精细工作，对耐心和责任心要求极高
- 适合热爱IC验证、追求技术深度、抗压能力强且愿意在高强度环境中打磨技能的资深工程师
缺点 / 挑战
- 技术栈复杂，需要持续学习最新协议和验证方法学，压力较大
角色解读
- 从验证专家向芯片架构师或技术负责人方向发展，参与更前端的芯片设计决策
- 在达摩院深耕RISC-V生态，成为该领域顶尖技术专家，拥有行业影响力
- 可横向拓展至AI芯片、服务器芯片等更多高端芯片项目，职业空间广阔
- 负责SOC及子系统级高速接口的集成验证，制定验证策略并完成验证计划
- 搭建验证环境，编写Testbench和用例，收集覆盖率并执行仿真与调试
- 承担EMU平台上的压力场景验证，如跨DIE一致性、P2P/P2M等复杂场景
- 与芯片设计团队紧密合作，定位和解决总线验证中的bug
- 精通SystemVerilog、UVM等验证语言和方法学，具备扎实的面向对象编程能力
- 熟练使用Synopsys/Cadence仿真调试工具及各类VIP，如CHI/ACE/AXI、PCIE、UCIE
- 深入理解PCIe/CXL/UCIE等高速总线协议，掌握Controller和PHY层知识
- 具备总线一致性、流控、Chiplet、跨DIE等复杂验证经验
申请策略
- 提前了解达摩院芯片研发方向，特别是平头哥半导体相关的产品线
- 面试时准备一个完整的验证项目介绍，突出从策略到signoff的全流程
- 突出高速总线验证项目经验，特别是PCIe/CXL/UCIE相关成果
- 强调UVM环境搭建和覆盖率收敛的量化数据（如覆盖率提升百分比）
- 展示跨DIE、Chiplet等复杂验证场景的解决方案
- 注明C/C++编程能力和脚本自动化经验
- 深入学习UCIE协议规范及PHY层细节
- 熟悉业界最新的验证方法学，如便携式激励标准（PSS）
面试指南
- 采用STAR法则：情境(Situation)、任务(Task)、行动(Action)、结果(Result)结构性回答项目经验
- 对于技术问题，先阐述原理，再结合具体案例说明，最后总结关键经验和教训
- 展示逻辑思维：定义问题→分析根因→设计解决方案→验证效果
- 请介绍你参与过的一个高速总线验证项目，如何制定验证策略并收敛覆盖率？
- 如何验证PCIe或UCIE的一致性？遇到过哪些棘手问题？
- UVM环境中的sequence和driver如何协同？
- 在EMU平台上如何设计跨DIE压力场景？
- 如果芯片流片后发现问题，你会如何回溯验证？
职位点评
薪资福利75
成长发展90
工作生活60
使命价值65
薪资福利
75中等
该职位薪资竞争力强，但具体福利未在JD中明确，整体补偿性较好。
薪资信号未披露（AI估算：40K-70K/月）
成长发展
90较高
职位涉及RISC-V、Chiplet等前沿技术，技术挑战大，成长空间极高。
技术前沿前沿/新兴技术
技术栈SystemVerilog、UVM、PCIe、CXL、UCIE、Chiplet、RISC-V
业务类型ambiguous
工作生活
60中等
工作地点在园区，但JD未提及弹性或WLB，可能需根据项目节奏加班。
工作模式仅现场办公
办公地点科技园/产业园
加班情况未提及（无法判断）
使命价值
65中等
参与国产高端芯片研发，有技术创新意义，但JD未明确社会价值导向。
行业发展高速增长赛道
社会影响中性/一般
创新程度积极采用新技术
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