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Senior Mixed Signal Design Engineer
Senior Mixed Signal Design Engineer
发布于 1 小时前普通员工/个人贡献者
全职员工仅现场办公硬件工程
硬件工程
Cmos
Matlab
Pll
信号完整性
数据转换器
混合信号设计
硅片调试
高速接口电路
值不值得投
80综合评分
综合评分 80
顶尖AI芯片底层研发岗，技术前沿、薪酬优厚，适合追求硬核技术成长的硬件工程师
从薪资福利、成长发展、工作生活和使命价值四个维度综合评估，方便横向比较。
薪资怎么样
3.3万
比硬件工程中位数低
发布情况
新岗位 · 今天发布
公司情况
这家公司招聘很活跃
约 330 个在招 · 其中硬件工程 18 个
市场机会
选择面较广
新竹 · 硬件工程 · 78 个在招
职位详情
关于这个职位
负责CMOS高速接口电路与混合信号电路的架构定义与设计，主导高速收发器及高频PLL等项目的全流程开发
需深入实验室开展硅片验证、调试与特性表征，指导版图设计团队，并协同跨部门完成从技术实现到产品落地的全周期工作
最低要求
电气工程专业学士或硕士学位（博士优先）
具备5年以上CMOS模拟/混合信号电路设计经验
熟悉Cadence定制设计工具、电路仿真及时序分析工具
拥有优秀的团队协作与人际沟通能力，具备验证过的带领和指导设计师的经验
在数据转换器、发射机(Tx)、接收机(Rx)、时钟数据恢复(CDR)、锁相环(PLL)等高速IO接口方面有广泛的设计经验
深入理解深亚微米CMOS工艺及相关电路设计问题
必须具备硅片上线(bring-up)、调试及实验室仪器使用经验
了解系统级时序预算、信号完整性及电源完整性者优先
掌握Verilog、Matlab、Nanotime者更佳
工作职责
参与高速接口电路的设计与实现
负责创建包括高速收发器和高频PLL在内的项目
参与混合信号电路的设计、仿真与验证
领导掩膜版设计师，为平面图和版图设计提供指导
为实验室硅片特性表征提供支持，攻克深亚微米CMOS电路设计挑战
将设计从实施推进至产品化阶段，并与跨职能团队紧密协作
优先资格
博士学位
具备系统级时序预算、信号完整性及电源完整性知识
熟悉Verilog、Matlab、Nanotime工具
AI 洞察
优缺点分析
优点
- 依托顶级平台接触前沿AI芯片底层设计，技术视野开阔
- 技术栈高度聚焦高速接口与混合信号，行业壁垒深且不可替代性强
- 薪酬福利与股权激励具备国际竞争力，职业保障度高
- 深亚微米电路设计容错率低，对仿真精度与调试能力要求极高
- 技术迭代迅速，需持续跟进先进工艺节点与新型接口标准
- 具备扎实微电子/集成电路基础，热爱底层硬件研发，追求技术深度突破的工程型人才
缺点 / 挑战
- 跨部门协作频繁，需平衡设计周期、良率与产品化进度压力
角色解读
- 向首席工程师或技术专家方向发展，深耕底层电路架构与先进制程
- 转向技术管理岗，负责更大规模的芯片设计团队与项目交付
- 拓展至系统级芯片(SoC)或新一代高速接口标准研发领域
- 负责CMOS高速接口与混合信号电路的架构设计与实现，涵盖从仿真验证到硅片调试的全流程
- 主导高速收发器及PLL等核心模块的开发，确保电路性能与指标达标
- 指导版图设计团队，协同跨部门完成产品化落地与量产支持
- 精通CMOS模拟/混合信号电路设计，熟悉深亚微米工艺特性
- 熟练掌握Cadence等EDA工具链及电路仿真分析方法
- 具备硅片bring-up、实验室调试及精密仪器操作能力
- 了解高速IO接口协议、信号/电源完整性及系统级时序预算
申请策略
- 提前研究英伟达最新GPU架构中的接口技术路线与专利布局
- 准备详细的过往项目技术复盘，重点展示排错逻辑与数据支撑
- 突出5年以上CMOS混合信号设计实战经验，量化关键项目成果与流片成功率
- 详细列出掌握的EDA工具链及硅片调试成功案例，体现端到端交付能力
- 强调高速IO接口(PLL/CDR/Tx/Rx)专项技能与信号完整性分析能力
- 深化对先进制程下PDK特性、寄生参数提取及噪声抑制机制的理解
- 补充高速SerDes架构理论与系统级验证方法论的学习
- 提升项目管理与跨团队沟通技巧以适配产品化节奏
面试指南
- 采用STAR法则结构化回答项目背景、任务目标、行动步骤与量化结果
- 结合理论公式与仿真数据说明设计决策依据，展现底层原理掌握度
- 突出调试过程中的逻辑排查思路与仪器使用熟练度，体现实战经验
- 请分享一个你主导的高速PLL或SerDes设计案例，遇到的最大挑战及如何解决？
- 在深亚微米工艺下，如何保证混合信号电路的噪声抑制与信号完整性？
- 描述一次完整的硅片bring-up经历，你是如何利用仪器定位问题的？
- 如何评估系统级时序预算对前端电路设计的影响？
- 复习CMOS模拟电路核心知识点（运放、比较器、参考源等）及噪声分析
职位点评
薪资福利85
成长发展90
工作生活60
使命价值80
薪资福利
85较高
薪资与股权激励处于行业领先水平，福利体系完善，能充分满足求职者对高回报与稳定性的期待。
薪资信号偏高 (2.5千–4.0万/月)
成长发展
90较高
接触全球顶尖AI芯片底层设计，技术栈前沿且成长空间广阔，导师制与跨团队协作机制完善。
技术前沿前沿/新兴技术
技术栈CMOS、混合信号设计、PLL、SerDes、Cadence、硅片调试、Verilog、Matlab
成长机会mentorship for floorplan and layout design、Collaborate with multi-functional teams
业务类型profit_center
工作生活
60中等
硬件研发通常需驻场配合流片与实验室调试，工作节奏受产品节点驱动，但公司提供灵活的工作氛围。
工作模式未明确
办公地点科技园/产业园
加班情况未提及（无法判断）
使命价值
80较高
直接参与推动AI与高性能计算发展的核心芯片研发，社会价值与技术使命感强烈。
行业发展高速增长赛道
社会影响正向社会影响力较高
使命信号amplify human inventiveness and intelligence、ignited modern AI — the next era of computing
创新程度开拓性创新（行业首创）
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