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ASIC Physical Design Engineer
ASIC Physical Design Engineer
发布于 2 小时前普通员工/个人贡献者
全职员工仅现场办公硬件工程
硬件工程
Eda工具
Sta
Tcl
布局规划
形式验证
时序收敛
芯片物理设计
值不值得投
82综合评分
综合评分 82
顶尖芯片平台、前沿技术栈、高成长空间，项目驱动型研发岗位。
从薪资福利、成长发展、工作生活和使命价值四个维度综合评估，方便横向比较。
薪资怎么样
4.8万
比硬件工程中位数高
发布情况
新岗位 · 今天发布
公司情况
这家公司招聘很活跃
约 330 个在招 · 其中硬件工程 23 个
市场机会
选择面较广
上海 · 硬件工程 · 约 900 个在招
职位详情
关于这个职位
负责从RTL到GDSII的完整物理设计流程，涵盖静态时序分析、约束管理、时序收敛、综合签核、芯片分区布局及流程自动化
需协同架构与DFT团队推动物理友好设计，应用最先进制程打造顶级芯片
最低要求
电子工程(EE)、计算机科学(CS)或微电子相关专业硕士学历
具备1年以上相关经验者优先
拥有集成电路(IC)设计实现的项目经验
修读过电路设计与数字设计相关课程
熟悉使用EDA软件（如Synopsys的FC/DC/PT/Formality，Cadence的RC compiler/Genus/LEC）者优先
熟练使用Python、Perl或TCL脚本语言者优先
具备熟练的英文读写能力
工作职责
负责分层设计的静态时序分析(STA)
进行约束创建与验证，管理时序预算
完成分区级和全芯片级的时序收敛
处理特殊场景的时序收敛，如IO、测试、时钟等
执行综合、网表质量检查及形式验证
实施芯片分区与布局规划(Floorplan)
生成功能ECO（工程变更）
开发并优化从前端(pre-layout)到后端(post-layout)的完整时序收敛流程
进行流程自动化开发及相关方法论建设
优先资格
精通Perl、Python或TCL脚本语言
具备优秀的英语沟通能力
AI 洞察
优缺点分析
优点
- 依托顶尖GPU/AI芯片平台，接触业界最前沿制程与超大芯片项目
- 技术栈高度专业化，能积累深厚的物理设计方法论与自动化开发经验
- 外企文化规范，培训体系完善，职业背书强
- 跨团队协作复杂，需频繁对齐架构与物理实现的边界条件
- 技术更新快，需持续跟进新节点工艺与EDA工具演进
- 适合具备扎实IC设计基础、热爱底层硬件实现、追求技术深度且抗压能力强的工程师
- 偏好稳定技术成长路径、希望在大厂平台深耕专业领域的求职者
缺点 / 挑战
- 芯片流片周期长、压力大，需应对严苛的PPA指标与多轮迭代
角色解读
- 可向资深物理设计专家、流程与方法论负责人发展，或横向拓展至后端架构、DFT集成、芯片验证等领域
- 长期可成长为技术总监或首席工程师，主导先进制程芯片的物理实现与项目交付
- 负责芯片从逻辑网表到物理版图(GDSII)的全流程实现，核心任务是时序收敛与PPA指标优化
- 利用主流EDA工具进行综合、布局布线、签核验证，确保芯片满足性能与可靠性标准
- 与架构、DFT、SI等多部门紧密协作，解决跨模块设计兼容性与物理实现边界问题
- 扎实的数电/模电基础与IC设计实现理论
- 精通Synopsys/Cadence主流EDA工具链及脚本自动化(Python/TCL/Perl)
- 熟练掌握STA、时序收敛策略、ECO处理及形式验证方法
- 优秀的英文技术文档阅读与跨团队沟通能力
申请策略
- 提前研究英伟达最新GPU架构特点及物理设计痛点，准备1-2个完整的IC实现项目案例（STAR法则）
- 关注外企技术面试风格，注重逻辑表达与英文沟通流畅度
- 突出IC设计全流程项目经验，详细列出使用的EDA工具、脚本语言及具体贡献（如时序收敛率提升、ECO数量、自动化脚本覆盖率）
- 强调跨团队协作成果与英文技术文档撰写能力
- 深入掌握STA高级特性与时序收敛策略，补充Python/TCL在流程自动化中的应用案例
- 熟悉先进制程(7nm/5nm及以下)的物理设计挑战与PDK特性
面试指南
- 采用“背景-任务-行动-结果”结构，聚焦技术决策依据与量化成果
- 强调问题拆解思路、工具链组合策略及跨团队协同机制
- 突出自动化思维与持续优化意识
- 请分享一个你主导的时序收敛项目，遇到的最大瓶颈及解决方案？
- 如何使用Python/TCL优化现有物理设计流程？请举例说明
- 面对多电压域或多时钟域的复杂设计，你的约束管理与签核策略是什么？
- 如何平衡PPA指标与物理实现的可制造性(DRC/LVS)？
- 复习数字电路基础、STA原理、时序违例类型及修复方法
职位点评
薪资福利85
成长发展92
工作生活65
使命价值80
薪资福利
85较高
英伟达作为上市巨头提供具有竞争力的薪酬与完善的福利体系，符合市场高标准。
薪资信号偏高 (3.5千–6.0万/月)
成长发展
92较高
岗位直接对接全球最先进制程与超大芯片项目，技术前沿性强，内部专家协作与流程开发机会丰富，成长空间巨大。
技术前沿前沿/新兴技术
技术栈STA、时序收敛、EDA、Synopsys、Cadence、Python、TCL、芯片物理设计
业务类型profit_center
工作生活
65中等
JD未明确提及办公模式与加班情况，仅说明需与专家团队协同推进先进制程芯片项目，整体节奏依项目节点而定。
工作模式未明确
办公地点科技园/产业园
加班情况未提及（无法判断）
使命价值
80较高
参与打造全球领先的AI/GPU芯片，技术突破直接赋能计算生态，行业前景广阔且具有显著的技术影响力。
行业发展高速增长赛道
社会影响正向社会影响力较高
创新程度积极采用新技术
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