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达摩院-芯片PCIe/CXL设计专家-计算技术
达摩院-芯片PCIe/CXL设计专家-计算技术
发布于 3 小时前普通员工/个人贡献者
全职员工仅现场办公芯片设计
芯片设计
Ai Soc
Cxl
Pcie
Rtl设计
微架构设计
芯片验证
计算机体系结构
值不值得投
78综合评分
综合评分 78
顶尖大厂、前沿AI芯片技术、高薪高挑战、WLB一般
从薪资福利、成长发展、工作生活和使命价值四个维度综合评估，方便横向比较。
薪资怎么样
8.0万
比芯片设计中位数高
发布情况
新岗位 · 今天发布
公司情况
这家公司招聘很活跃
约 4630 个在招 · 其中芯片设计 约 160 个
市场机会
选择面较广
北京 · 芯片设计 · 约 180 个在招
职位详情
关于这个职位
负责定义和优化高性能PCIe/CXL互联架构，满足AI SoC需求
主导子系统微架构设计与RTL实现，协同软硬件团队完成项目交付
需具备深厚的协议理解与芯片研发经验
最低要求
硕士或以上学历，集成电路、电子工程、计算机科学或相关领域
熟悉PCIe Gen 5/6、CXL 2.0/3.0协议，深入理解相关体系结构
扎实的RTL设计能力和良好的逻辑思维能力
强大的团队合作能力、优秀的沟通能力和项目管理能力
年以上相关领域工作经验，至少一次完整留片经验
工作职责
定义先进的PCIe/CXL系统架构、硬件设计和软硬件协同创新
负责子系统的微架构设计和RTL实现
支持SoC相关软硬件团队，按项目节点交付
优先资格
熟悉计算机体系结构，深入理解IOMMU、ATS、Cache等领域架构和设计
有PCIe Gen5或以上速率的IP自研或研发经验，熟悉常用IP的集成及相关Flow，熟悉PIPE接口，具有丰富的调试和硅后测试经验
具有芯片性能仿真和分析经验，熟悉Gem5/Qemu/SystemC等，具备常见的PCIe设备性能瓶颈分析能力和优化经验
AI 洞察
优缺点分析
优点
- 接触前沿AI芯片技术，平台资源丰富，行业影响力大
- 适合在芯片互联领域有深厚积累的高级工程师或架构师
缺点 / 挑战
- 技术迭代快，对底层架构理解要求极高，工作压力较大
角色解读
- 可向首席架构师、技术总监方向发展，成为芯片互联领域的顶级专家
- 负责定义和优化高性能PCIe/CXL互联架构，以满足AI SoC的性能和可拓展性需求
- 精通PCIe Gen 5/6、CXL 2.0/3.0协议，具备扎实的RTL设计能力和微架构设计经验
申请策略
- 准备详细的项目案例，展示解决复杂技术问题的能力
- 突出PCIe/CXL协议掌握程度、RTL设计能力及完整流片经验
- 深入研究Gen5/6最新协议特性，提升系统级仿真与分析能力
面试指南
- 使用STAR法则（情境、任务、行动、结果）详细描述项目经历，强调技术难点与解决方案
- 请描述你参与的PCIe/CXL项目中的具体贡献
- 如何优化PCIe Gen5的性能瓶颈？
- 解释IOMMU和ATS的工作原理及其在系统中的角色
- 复习PCIe/CXL协议细节，准备典型的技术难题解答思路
职位点评
薪资福利90
成长发展95
工作生活40
使命价值70
薪资福利
90较高
作为上市巨头企业的资深专家岗，提供极具竞争力的薪酬福利，满足度高。
薪资信号未披露（AI估算：6.0千–10.0万/月）
成长发展
95较高
涉及前沿AI芯片互联技术，技术栈领先，成长空间巨大。
技术前沿前沿/新兴技术
技术栈PCIe Gen 5/6、CXL 2.0/3.0、RTL、AI SoC、Gem5
业务类型profit_center
工作生活
40较低
大厂核心研发岗通常工作强度较高，WLB相对有限。
工作模式未明确
办公地点市区核心地段
加班情况未提及（无法判断）
使命价值
70中等
参与AI基础设施核心技术研发，具有显著的行业价值和技术意义。
行业发展高速增长赛道
社会影响正向社会影响力较高
创新程度积极采用新技术
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